说实话,没懂起你什么意思
是指initial语句中赋值吗?要利用复位来赋值
用reset 给reg赋初值咯
FPGA ASIC quartus Xilinx vivado verilog ALTERA CPLD 集成电路 相关文章:
Copyright © 2017-2020 微波EDA网 版权所有
网站地图