直接数字频率合成器DDS的优化设计

过采用三种优化与设计技术：(1)使用流水线累加器在不过多增加门数的条件下，大幅提高了芯片的工作速度;(2)压缩成正弦查找表，在保证芯片使用精度的情况下减少了近3/4面积，大大节约了ROM的容量。(3)采用同步接口电路设计方案，消除了系统的接口不稳定性。同时使用VHDL语言实现了优化，并把该设计适配到Xilinx公司的最新90nm工艺的Spartan3E系列的FPGA中，实际结果表明了本文给出的DDS设计方案在硬件开销方面的优势。