多时钟域数据传递的FPGA实现

4 结 语

针对异步并行通信接口芯片设计中涉及的多时钟域的数据传递问题，本文采用FIFO存储器来完成不同时钟域之间数据流传递、同步器来完成控制信号传递的方案。仿真验证结果表明，数据传递准确、稳定、可靠，没有出现竞争冒险和亚稳态，完全达到了设计要求。