导入灵活的FPGA验证方法
时间:06-21
来源:电子系统设计
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对工研院而言,ProtoLink Probe Visualizer是一种相当有效的 FPGA 原型板侦错方法。工程师再也不必局限在传统的侦错方法,而且在实时应用软件中增加观察点也可能会造成其它问题。透过维持原有软件并监测更多FPGA 讯号在数百万时脉周期内的实时 RTL 行为,使用者可以获得所需的能见度,更完美的掌握、更轻松地侦错设计的问题。
总合来说,思源科技Probe Visualizer 透过以软件为基础的创新方法,改变了原型板验证的方法,实现丰富、实时的设计能见度,并且让原型板能使用 Verdi 的侦错威力,使原型板侦错时间比传统的方法大幅缩短一半。这种侦错作业生产力与整体验证效率的提升,不仅能协助工研院在更早期的 SoC 研发流程中配置 FPGA 原型,并且能迅速移转至搭载最新 FPGA 技术的新一代原型板上,充分运用最新 FPGA 技术的优势。
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