微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > PCB设计问答 > Cadence Allegro > 关于约束规则设置的问题

关于约束规则设置的问题

时间:10-02 整理:3721RD 点击:
最近我通过论坛里DEA手册学习cadence,当我看到约束的时候有些问题还是不明白想请教一下:
1、在net下signal integrity 下的electrical properties内的CLK行下的frequency,是什么呢频率是信号频率还是什么频率
2、在net 下timing的switch/settle delay 是如何计算出来的
3、系统反射信号参数是如何计算的。

期待解答

今天敬请各位能帮我解答

怎么还没有人帮我解答呀

关键是这个问题很大,不是一句几句能解释明白的呵呵

要用這個功能 ,  必須要有 SI License .
有 SI License , 您還要懂 SI 才能用.

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top