SD卡布线要求
时间：10-02
整理：3721RD
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现在在布块POWER PC的板子，有个SD卡。
以前布的SD卡地直接拉到FPGA，时序可以自己调整。
现在的SD卡是拉到power pc上的，别人给了个时序要求：
0<Tc-Td<8ns
6<Tc-Td<11ns (Tc时钟延时，Td数据延时)
如果取Td=1sn(6inch),那么Tc为5-7ns （30-40inch）
这样绕出来的线，老长老长的，请问这样的要求合理么?
先谢谢各位了！
以前布的SD卡地直接拉到FPGA，时序可以自己调整。
现在的SD卡是拉到power pc上的，别人给了个时序要求：
0<Tc-Td<8ns
6<Tc-Td<11ns (Tc时钟延时，Td数据延时)
如果取Td=1sn(6inch),那么Tc为5-7ns （30-40inch）
这样绕出来的线，老长老长的，请问这样的要求合理么?
先谢谢各位了！
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