allegro错误
时间:10-02
整理:3721RD
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目的是改板,原理图改动较大,导网表时如果是新PCB文件可以完全导入,但导入旧文件时提示如上所示的错误
看不清啊
这个问题解决了,我用的是15.7,后来叫同事用15.5给我导的试验了下,导成功了。我用15.7才出现这问题。
目的是改板,原理图改动较大,导网表时如果是新PCB文件可以完全导入,但导入旧文件时提示如上所示的错误
看不清啊
这个问题解决了,我用的是15.7,后来叫同事用15.5给我导的试验了下,导成功了。我用15.7才出现这问题。