延时问题
时间:10-02
整理:3721RD
点击:
用VERILOG写代码
我的输入时钟周期为3个高电平+2个低电平
我如何将时钟延时半个周期?
我的输入时钟周期为3个高电平+2个低电平
我如何将时钟延时半个周期?
不明白你的意思