DSP电磁的兼容性问题简析

能够做到对阻抗的有效控制，其内部的走线可形成易懂和可预测的传输线结构。且要密封电源和地板层之间的线迹;(9)保持相邻激励线迹之间的间距大于线迹的宽度以使串扰最小;(10)时钟信号环路面积应尽量小;(11)高速线路和时钟信号线要短且要直接连接;(12)敏感的线迹不要与传输高电流快速开关转换信号的线迹并行;(13)不要有浮空数字输入，以防止不必要的开关转换和噪声产生;(14)避免在晶振和其它固有噪声电路下面有供电线迹;(15)相应的电源、地、信号和回路线迹要平行布景，以消除噪声;(16)使时钟线、总线和片使能端与输入/输出线和连接器分隔开来;(17)使路线时钟信号与I/O信号处于正交位置;(18)为使串扰最小，线迹用直角交叉和散置地线;(19)保护关键线迹(用4密耳到8密耳线迹以使电感最小，路线紧靠地板层，板层之间夹层结构，保护夹层的每一边都有地)。

2.7.2 采用滤波技术降噪方法

(1)对电源线和所有进入PCB的信号进行滤波，在IC的每一个点引脚处用高频低电感陶瓷电容(14MHz用0.1 mF，超过15MHz用0.01mF)进行去耦;(2)旁路模拟电路的所有电源供电和基准电压引脚;(3)旁路快速开关器件;(4)在器件引线处对电源/ 地去耦;(5)用多级滤波来衰减多频段电源噪声;(6)把晶振安装嵌入到板上并且接地;(7)在适当的地方加屏蔽;(8)安排邻近地线紧靠信号线，以便更有效地阻止出现新的电场;(9)把去耦线驱动器和接收器适当地放置在紧靠实际的I/O接口处，这可降低PCB与其它电路的耦合，并使辐射和敏感度降低;(10)对有干扰的引线进行屏蔽和绞在一起，以消除PCB上的相互耦合;(11)在感性负载上加箝位二极管。

3 DSP软件设计时应采取的措施

软件方面的干扰主要表现在以下几个方面：(1)不正确的算法产生错误的结果，最主要的原因是由于计算机处理器中的程序指数运算是近似计算，产生的结果有时有较大的误差，容易产生误动作;(2)由于计算机的精度不高，而加减法运算时要对阶，大数"吃掉"了小数，产生了误差积累，导致下溢的出现，也是噪声的来源之一;(3)由于硬件方面的干扰引起的计算机出现的诸如：程序计数器PC值变化、数据采集误差增大、控制状态失灵、RAM数据受干扰发生变化以及系统出现"死锁"等现象。

3.1 采用拦截失控程序的方法

(1)在程序设计时应多采用单字节指令，并在关键处插入一些空操作指令，或将有效单字节指令重复几次，这样可保护其后的指令不被拆散，使程序运行走上正轨;(2)加入软件陷阱：当PC值失控使程序失控后，CPU进入非程序区，这时可用一条引导指令，强迫程序进入初始入口状态，进入程序区，可每隔一段设置一个陷阱;(3)软件复位：当程序"走飞"时，运行监视系统，使系统自动复位而重新初始化。

3.2 设立标志判断

定义某单元为标志，在模块主程序中把该单元的值设为某个特征值，然后在主程序的最后判断该单元的值是否不变，若不同了则说明有误，程序就转入错误处理子程序。

1 引言

自从20世纪80年代初期第一片数字信号处理器芯片(DSP)问世以来，DSP就以数字器件特有的稳定性、可重复性、可大规模集成、特别是可编程性和易于实现自适应处理等特点，给数字信号处理的发展带来了巨大机遇，应用领域广阔。但由于DSP是一个相当复杂、种类繁多并有许多分系统的数、模混合系统，所以来自外部的电磁辐射以及内部元器件之间、分系统之间和各传输通道间的窜扰对DSP及其数据信息所产生的干扰，己严重地威胁着其工作的稳定性、可靠性和安全性[1]。据统计，干扰引起的DSP事故占其总事故的90%左右。同时DSP又不可避免地向外辐射电磁波，对环境中的人体、设备产生干扰、妨碍或损伤。并且随着DSP运算速度的提高，能够实时处理的信号带宽也大大增加，它的研究重点也转到了高速、实时应用方面。但正是这样，它的电磁兼容性问题也就越来越突出了，本文在DSP的电磁兼容性问题方面进行了一些探讨。

2 DSP硬件方面的电磁兼容性

电磁兼容性(EMC)包含系统的发射和敏感度两方面的问题。假若干扰不能完全消除，也要使干扰减少到最小。如果一个DSP系统符合下面三个条件，则该系统是电磁兼容的。(1) 对其它系统不产生干扰;(2) 对其它系统的发射不敏感;(3) 对系统本身不产生干扰。

2.1 DSP中的干扰主要来源

电磁干扰是通过导体或通过辐射产生的，很多电磁发射源，如光照、继电器、DC 电机和日光灯都可引起干扰。AC电源线、互连电缆、金属电缆和子系统的内部电路也都可能产生辐射或接收到不希望的信号。在高速数字电路中，时钟电路通常是宽带噪声的最大产生源。在快速DSP系统中，