基于DSP Builder的子带分解自适应滤波器的FPGA实现

ine wavel、Sinewavel+noise、Clock转换成针对HDL仿真器ModelSim的测试文件。由图7可知输出信号Sine out逐渐趋于稳定，逼近与期望信号sine wavel，因此设计结果满足要求，能够实现自适应过程。

　　5 结语

　　本文只是从硬件的角度出发设计两个子带自适应滤波器的FPGA实现。由于分解滤波器组的非理想特性，有必要采取子带间滤波，子带间的滤波可大大提高收敛速度。子带自适应滤波器的设计和研究过程是比较复杂的，这里就主要的设计研究思想做了一个阐述，鉴于设计中的自适应滤波器的阶数选取相对较小，因而对自适应滤波器的稳态误差有一定的影响，通过增加自适应滤波器的阶数，分析和综合滤波器的阶数、数据的位数来提高精度。