基于C语言在FPGA上实现DSP的解决方案

3对环境的仿真

再下一步是建立仿真环境，并在其中测试和优化硬件代码。仿真环境提供了完整的bit-true/cycle-true仿真，并对FPGA的实现进行可靠的模拟。利用设计输出与C软件仿真输出的比较来测试精度，同样也可得到FPGA处理器上真实运行速度的报告。通常，进行结构块仿真有助于找到设计中的问题，因为这些块在重组后可以确定总体的运行效果。可在仿真过程中做进一步的调整，如利用流水线在每个时钟周期内进行单输入单输出的测试，或将处理过程细分到更多的并行数据流中直到FPGA的资源利用率达到100%。此外，在硬件编译时也能发现算法的最慢点并对其优化，在FPGA甚至板子之间分割算法还可以获得额外的速度。利用软件，进一步调整可获得更好的性能。然而，精确调整带来的性能增益却会下降。通过简单的增加FPGA非常具有成本效益。并不需要使设计完美化，因为基于这些结果的设计可以在任何时候进行快速的仿真和优化。一旦仿真完成，就可以将设计编译到硬件里并激活数据流管理(DSM)，以便将数据流送到FPGA处理器板而不是仿真器中。

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