以太网控制器ENC28J60及其接口技术

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引言

　　ENC28J60是Microchip Technology（美国微芯科技公司）近期推出的28引脚独立以太网控制器。

　　在此之前，嵌入式系统开发可选的独立以太网控制器都是为个人计算机系统设计的，如RTL8019、AX88796L、DM9008、CS8900A、LAN91C111等。这些器件不仅结构复杂，体积庞大，且比较昂贵。目前市场上大部分以太网控制器的封装均超过80引脚，而符合IEEE 802.3协议的ENC28J60只有28引脚，既能提供相应的功能，又可以大大简化相关设计，减小空间。

图1 ENC28J60的硬件连接

1 结构和功能

　　采用业界标准串行外设接口（SPI）的以太网控制器ENC28J60具有以下主要特征：

　　◆ 符合IEEE 802.3协议。内置10 Mbps以太网物理层器件（PHY）及媒体访问控制器（MAC），可按业界标准的以太网协议可靠地收发信息包数据。
　　◆ 具有可编程过滤功能。特殊的过滤器，包括Microchip的可编程模式匹配过滤器，可自动评价、接收或拒收Magic PACket，单播（UNIcast）、多播（Multicast）或广播（Broadcast）信息包，以减轻主控单片机的处理负荷。
　　◆ 10 Mbps SPI接口。业界标准的串行通信端口，使得低至18引脚的8位单片机也具有网络连接功能。
　　◆ 可编程8 KB双端口SRAM缓冲器。以高效的方式进行信息包的存储、检索和修改，以减轻主控单片机的内存负荷。该缓冲存储器提供了灵活可靠的数据管理机制。

2 硬件设计

　　ENC28J60的硬件设计需要注意复位电路，时钟振荡器，振荡器启动定时器，时钟输出引脚，变压器、终端和其他外部器件，输入/输出电平等几个方面。（图1可供参考）

2.1 复位电路

　　ENC28J60有上电复位(Power-on Reset)功能，RESET引脚上的低电平使ENC28J60进入复位模式；RESET引脚内部有弱上拉电阻。ENC28J60的硬件连接如图1所示。

2.2 时钟振荡器

　　ENC28J60需要一个25 MHz的晶振，接在OSC1和OSC2脚上；也可由外部时钟信号来驱动。此时3.3 V的外部时钟接在OSC1脚上，OSC2断开或者通过一个电阻接地来降低系统噪声。

2.3 振荡器启动定时器

　　ENC28J60内部有一个振荡器启动时钟OST(Oscillator Startup Timer)，上电7 500个时钟周期(300 μs)，OST期满后内部的PHY方能正常工作。这时不能发送或者接收报文。上位机可通过检测ENC28J60内部ESTAT寄存器中的CLKRDY位的状态来决定是否可设置发送或接收报文。

　　需要注意的是，当ENC28J60上电复位或者从PowerDown模式下唤醒时，必须检测ESTAT寄存器中的CLKRDY是否置位。只有CLKRDY置位后才能发送、接收报文，访问相关寄存器。

2.4 时钟输出引脚

　　CLKOUT引脚可为系统中的其他设备提供时钟源。上电后CLKOUT引脚保持低电平，复位结束后OST计数。OST期满后，CLKOUT输出频率为6.25 MHz的时钟。

　　时钟输出功能通过ECOCON寄存器禁止、调整和使能。时钟输出可设置为1、2、3、4、8分频，上电后默认为4分频。ECOCON寄存器配置改变以后，CLKOUT引脚有80～320 ns的延迟(保持低电平)，然后按照设定输出固定频率的时钟信号。

　　软件或者RESET引脚上的复位信号不会影响ECOCON寄存器的状态。PowerDown模式也不会影响时钟的输出。当禁止时钟输出时，CLKOUT引脚保持低电平。

2.5 变压器、终端和其他外部器件

　　为了实现以太网接口ENC28J60，需要几个标准的外部器件：脉冲变压器、偏置电阻、储能电容和去耦电容。

　　差分输入引脚(TPIN+/TPIN-)，需要一个1∶1变比的脉冲变压器来实现10BASET。差分输出引脚(TPOUT+/TPOUT-)，需要一个变比为1∶1、带中心抽头的脉冲变压器。变压器需要有2 kV或更高的隔离能力，防静电。对变压器的详细要求请参考芯片手册第16章“电气特性”。每个部分都需要通过2个50 Ω、精度为1%的电阻和1个0.01 μF的电容串联后接地。

　　笔者采用的是中山汉仁公司的集成以太网隔离变压器RJ45插座HR901170A。

　　ENC28J60内部的模拟电路需要在RBIAS引脚和地之间跨接1个2 kΩ、1%的偏置电阻。部分数字电路工作在2.5 V，以降低功耗；ENC28J60内部集成1个2.5 V的调节器来产生所需的电压，需在VCAP引脚和地之间接1个10 μF的电容保证供电的稳定性（该2.5 V调节器不是为外部负载设计的）。

　　所有的供电引脚(VDD、VDDOSC、VDDPLL、VDDRX、VDDTX)必须接在外部的同一个3.3 V电源上；同理，所有的地(VSS、VSSOSC、VSSPLL、VSSTX)必须接在同一个外部地上。每个供电引脚和地之间应当接1个0.1 μF的陶瓷电容去耦（电容要尽可能接近供电引脚）。

　　驱动双绞线接口需要较大的电流，所以电源线应尽可能宽，与引脚的连接尽可能短，以降低电源线内阻的消耗。

2.6 输入输出电平

ENC28J60是一个3.3 V的CMOS器件，但它设计得非常

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