基于FPGA的高速数据采集系统的设计方案
时间:10-08
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rdreq;异步清零aclr;存储数据溢出信号full.
5.结论
本文完成高速、多通道的数据采集系统的FPGA设计。利用VHDL语言对FPGA进行设计,并在QuartusⅡ中进行系统仿真和验证。
由FPGA在线编程的特点,可以依据现场的具体情况,对FPGA的内部配置进行修改,进一步增加了系统应用的灵活性,因此该系统是一种比较理想的实时高速数据采集方案
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