ASIC设计中不可忽视的几大问题

现的一些情况，如复位，状态机的翻转。充分的验证应该包括在bestcase下检查短路径的hold时间，在worstcase下检查长路径的setup时间。这些问题虽然在STA也作了检查，门级仿真还是很必要的，尤其在用到时钟双边沿的设计中;另外，对于有异步时钟接口的设计，需要调整异步时钟的相位关系，检查是否存在着同步失败问题;3.3中特殊时钟问题，都可以通过门仿验证其正确性;一些窄脉冲是否能通过IOBuffer。总之，这是一个非常重要的过程，需要花大量的时间去分析一些关键信号的波形与设想的是否一致。

　　总结

ASIC设计是一个复杂和全局的过程，从结构设计、代码设计、综合以及物理设计、时序分析、门级仿真，整个过程周期长，每个环节都不能孤立的思考。需要设计人员花费大量的时间去降低或消除设计中潜在的风险，才能设计出功能正确，性能满足要求的产品。因此，IC设计的工具如果能在很大程度上缓解设计人员的操作压力，令其可以安心进行设计工作，这样的设计工具对于设计师来说，可以说是一枚“利器”。