便携式逻辑分析仪的设计与实现

摘要 介绍一种16通道便携式逻辑分析仪，通过FPGA将高速数据采样并缓存，采用USB控制芯片和FPCA协同控制将数据通过USB接口发送到电脑的上位机上显示，简化了以往逻辑分析仪硬件电路部分，降低了逻辑分析仪的成本且便于携带。重点阐述硬件电路部分的设计。

关键词 逻辑分析仪;USB接口;FPGA;FIFO传输

逻辑分析仪是数字设计验证与调试过程中应用广泛的工具，其能够检验数字电路是否正常工作，并帮助用户查找并排除故障。每次可捕获并显示多个信号，分析这些信号的时间关系和逻辑关系。根据硬件设备设计上的差异，目前逻辑分析仪大致可分为独立式和需结合电脑的卡式虚拟逻辑分析仪。独立式逻辑分析仪性能优异，但价格昂贵，一般用户较少使用。而本项目所实现的便携式逻辑分析仪，以较低的成本提供了相应的性能，虽然性能有所下降，但完全可以满足一般的逻辑信号分析，并且使成本大幅度下降，仪器体积较小，便于携带，适合普通用户的使用。

1 系统总体设计方案

本逻辑分析仪可实现16通道逻辑分析，输入信号可以是模拟信号或数字信号;可测量宽范围输入电平，支持1.8～5 V电平采样;采用芯片CY7C68013A作为主控芯片，通过USB 2.0将其与电脑连接传输数据信息，使用FPGA实现高采样速率，每通道都支持12 Mbit·s-1高速采样;被采样的信号按顺序存储在存储器中。采样信息以“先进先出”的原则组织在存储器中，得到显示命令后，按照先后顺序逐一读出信息，按设定的显示方式进行被测量的显示。这样就可以在软件界面观测到所需要的数字波形，并可设置触发方式，显示所需要的波形。

本项目采用CY7C68013A作为USB采集主控芯片，利用XC6SLX9作为数据通道的选择器件，选择输入到CY7C68013A的数据是来源于数字信号还是模拟信号经ADC模块之后的数字信号。由于该逻辑分析仪为USB连接，故此在USB连接端口上加入ESD芯片。并在板上增加16 kB的EEPR0M来作为CY7C68013A的程序存储器。图1为逻辑分析仪的基本组成框图。

项目所采用的CY7C68013A芯片为低功耗芯片，该芯片内核为增强型51核，内部有16 kB程序数据区，该芯片的主频为48 MHz，并且满足480 Mbit·s-1高速传输协议标准，符合USB2.0规范，并向下兼容USB1.1规范，基本能满足该项目的数据要求。

XC6SLX9为Xilinx公司生产的Spartan6系列的FPGA，具有9 152个逻辑单元。Spartan6系列产品基于公认的低功耗45 nm、9-金属铜层、双栅极氧化层工艺技术，提供了高级功耗管理技术、150 000个逻辑单元、集成式PCI Express模块、高级存储器支持、250 MHz DSP Slice和3.125Gbit·s-1低功耗收发器。该项目所选用的芯片为144脚封装的芯片，所拥有的IO能够满足数据高速通讯的要求。

在USB连接端加入ESD芯片能够更好的防止静电干扰，使得该逻辑分析仪使用起来更加安全可靠。

2 硬件电路设计

系统硬件设计主要包括与计算机接口部分和数据采集部分。通过FPGA完成触发设置，高速捕获数据和缓存的控制，使用CY7C68013A作为USB主控芯片完成与上位机的通信，将数据发送到计算机上位机上，并且接收上位机发送回的触发控制字及其他控制信息，与FPGA协同工作。电路分为USB主控模块，FPGA从控模块，数据采集模块，数据缓存模块，电源供电模块这5大模块。

2.1 USB主控模块

USB主控芯片选择的型号是CY7C68013A-56PVXC，该芯片集成USB 2.0收发器、增强型8051微处理器，适用性、外观和功能均与FX2兼容。具有16 kB片上代码/数据RAM，4个可编程的BULK/INTERRUPT/ISOCHRONOUS端点，8位或16位外部数据接口，且它的可编程接口可与大多数并行接口直接连接、由可编程波形描述符和配置寄存器定义波形、支持多个RDY和CTL输出，该芯片的工作电压为3.3 V，容限电压为5 V，集成I2C控制器。

USB主控芯片接24 MHz晶振，PB口接收来自于FPGA的FIFO数据，15脚和16脚接USB_B型接口的D+和D-，用于向上位机发送数据，同时接收上位机控制信息。I2C总线上接一AT24C64(EEPROM)用做USB程序存储器。其余的引脚用于读取FPGA的当前状态和发送触发等信息给FPGA，以确定何时进行读取数据。

2.2 FPGA从控模块

FPGA选用Xilinx Spartan-6系列的XC6SLX9-4TQ144C，接100 MHz的晶振。芯片中设定的16个IO引脚接收来自于74ALVC164245的16位三态总线收发器的数据，FPGA.VS[2：0]三引脚全部拉高，配置为快速读写模式，可以提高采样速率。Spartan-6系列FPGA中，配置模式引脚为M[1：0]，不像Spartan-3系列有3个配置引脚M[2：0]，这里配置为“10”，即主串模式。此时INIT_B引脚需要拉高，