基于FPGA实现DSP与Rapid IO网络互联

5 功能测试

目前，Altera 的RapidIO IP 核支持的RapidIO 事务有：读操作NREAD 请求和响应，写操作NWRITE 请求，带响应的写操作NWRITE_R 请求和响应，流写（SWRITE）请求，维护（MAINTENANCE）读请求和相应，维护（MAINTENANCE）写请求和响应，维护（MAINTENANCE）端口写请求，门铃（DOORBELL）请求和相应。在实际的测试中，将这个电路板和Mercury 公司Ensemble MPQ-101 同时安装在Silicontkx 的串行RapidIO 开发平台上，结果证实DSP 通过转接桥逻辑控制RapidIO IP 核，已经实现了所有的这些事务。

6 总结和展望

RapidIO 作为下一代嵌入式互联技术，在国内的信号处理平台上的运用越来越广泛。但是目前很多处理芯片不具有RapidIO 的接口。利用FPGA可以方便快速定制一个合适的接口，为RapidIO 网络增添各种丰富的节点。同时，本文给出了实现这个转接桥的思路做了详细讨论，这样不同的DSP，甚至CPU 都可以利用这种思路来接入RapidIO 网络。

在目前的设计中，一个 FPGA 为一个DSP 提供转接桥逻辑，过于浪费FPGA 的资源。在紧接下来的设计中，我们将4 片DSP 组成一簇接入FPGA，从而提高单板的处理能力，同时提高了FPGA 的利用率。

作者：朱含，岑凡      来源：《微计算机信息)(嵌入式与SOC)2009年第9-2期