基于SOPC和DDS IP核的可重构信号源设计与实现

搭建奠定基矗

　　2.6 DDS IP的仿真测试及自定义组件的生成

　　Altera公司的Quartus II软件具有嵌入式逻辑分析仪SignalTap II，它提供了一种对器件进行实时测试的手段。SignalTapII嵌入式逻辑分析仪可以随设计文件一起下载到目标芯片中，用以捕捉目标芯片中设计者感兴趣的信号节点处的信息，而不影响芯片的正常工作。

　　SignalTapII将测得的样本信号暂存于目标器件的片内RAM中，然后通过器件的JTAG端口和编程线将采得的信息传出，送入计算机进行分析。图4是采用SignalTapII嵌入式逻辑分析仪的仿真测试结果。

　　由于SOPC的开发是以组件（IP核）为基础的，为了将前面设计的DDS IP核挂到Avalon总线上，将其封装成为SOPCBuilder自定义的组件，如图5所示。这样，在SOPC硬件系统开发中，DDS IP就如同SOPC Builder里的标准组件一样，可以被集成到具体的应用系统中。

　　2.7 SOPC硬件系统配置

　　在SOPC硬件系统的开发中，除了集成前面设计的DDSIP外，还集成了诸多SOPC Builder组件库中的标准组件，主要有Nios II CPU、UAR T、JTAG UART、定时器、Avalon三态总线桥、片上存储器、片外存储器、PIO、SDRAM控制器、FLASH控制器等，如图6所示。

　　3 结论

　　论文以直接数字频率合成技术为理论依据，开发了DDSIP核，搭建了基于SOPC技术的信号发生器硬件系统，通过改变LPM_ROM模块中的波形数据，可以实现任意波形信号的产生。系统除了数／模转换部分外，其它部分都是在FPGA内部完成，具有实现容易、方便，减小了PCB设计的复杂度以及开发难度，缩短了开发周期等优点，同时，系统还具有很大的伸缩性，系统集成度高，属于SOC的范畴，符合技术发展潮流。