一文读懂嵌入式FPGA所有猫腻，改变芯片设计方式岂是闹着玩的

Flex Logix设计的EFLX阵列与所有可能的组合兼容。因此，验证芯片具有5个阵列：在所请求的VT组合中的1个大阵列（4×4）和在其他4种规模中的4个2x2阵列。

由于40nm的EFLX阵列可以以高达300MHz的频率工作，并且GPIO仅在150MHz以内才可靠，因此有一个片上PLL可以产生非常快速、精确的时钟用于测试性能，并且有SRAM可以使用"测试向量"加载，然后全速运行。这提供了"芯片上的测试器"，使得我们可以在上述GPIO速度下验证全速操作。还有温度／电压监视器，以确保在最坏的目标情况条件下进行测试。

所以说嵌入式FPGA将改变芯片和SoC未来的设计方式。 设计师无需再被困在项目中，并被迫花费数百万美元来在需要的时候改变RTL。 当RTL需要更新时，公司也不再会有延误计划的风险。使用嵌入式FPGA，芯片设计过程变得简单很多，价格也便宜很多。

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