微波EDA网,见证研发工程师的成长!
首页 > 研发问答 > 微电子和IC设计 > IC后端设计交流 > 做lvs时layout认不出dcap

做lvs时layout认不出dcap

时间:10-02 整理:3721RD 点击:
我在做lvs时,发现layout认不出来dcap导致lvs不过,然后我将cdl中的dcap都注掉,然后就过了。我用的工具是calibre。求助各位大神是不是在做lvs的时候要设置哪个option吗?

抽的过程中有错吗

保存netList时 将physical cell加到网表中

physical cell 没有加到网表里

这个是layout没有认出来decap吧,小编都说了注释掉cdl里decap就过了。
说明layout少东西。
试试LVS SPICE CULL PRIMITIVE SUBCIRCUIT YES

Copyright © 2017-2020 微波EDA网 版权所有

网站地图

Top