牛牛们给指点一下
时间：12-12
整理：3721RD
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工艺的提升如从.18到65n，
对于前端模块级设计，就是写RTL的，有什么主要区别，比如做个视频解码器。
对于前端模块级设计，就是写RTL的，有什么主要区别，比如做个视频解码器。
我遇到的问题就是：
里面固定了一些standard cell，换成新工艺的。
还有就是新工艺的memory时序不够，就从设计上加了delay。
别的我也不知道。