基于DSP的视频采集存储系统设计
时间：02-28
来源：21IC
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1 引言
视频采集系统在航天、工业等领域大量存在，随着多媒体技术的快速发展．对视频采集及处理技术系统的性能提出更高的要求，如高采集速度、低功耗、信号连续平滑、延时小、实时性及扩展性等。TI公司推出的TMS320DM642器件很好地解决了上述问题，其丰富的外围接口及专用的视频处理模块使得其非常适合日益发展的视频处理系统。这里，提出了以TMS320DM642为核心，由解码器TVP5150为视频输入解码处理器，与非门Flash为存储器、LXT971为网络传输器组成的集视频采集、压缩、存储、网络传输于一体的多功能视频处理系统。
2 系统硬件设计
图l给出系统硬件原理图。TMS320DM642器件具有强大的处理能力和丰富的外部设备接口。满足各种不同应用环境的控制与图像输出的需要。TMS320DM642在600 MHz的时钟主频下，数字处理能力可达到4 800MI／s，内部具有256 K字节的二级缓存结构：TMS320DM642具有4个可配置的视频接口(VP0～VP3)，能提供与通用视频编解码器等数据流的无缝连接，支持ITU-BT．656等多个视频标准；并具有多通道音频接口(McASP)、10／100 Mb／s以太网介质接入控制器(EMAC)，以适应网络和多媒体的需要，其片内64位的EMIF(Eixtemal Memoryr Interface)接口可以与SDRAM、Flash等存储器件无缝连接，极大方便大量数据的搬移。
TMS320DM642的Boot为EMIFA方式，系统在CEl空间外扩了一片Flash AM29LV320存储器作为程序存储器，当TMS320DM642上电或复位启动时，自动从AM29LV320上加载程序代码。另外系统在CEl空间外扩了一片NAND FlashK9 K8G08130M用来存储处理后的视频数据。同时系统采用Ahera公司的CPLD EPM3064ATCl00，管理系统内的控制信号，包括测试信号、复位信号、使能及中断信号、同步控制信号等，以及对TMS32013M642的部分地址空间的管理，CPLD还预留了部分引脚用于系统功能的扩展。同时TMS320DM642内部集成了以太网控制器外设，在外部只需外扩PHY物理层器件LXT971就可为系统构建一条100 Mb／s的高速以太网接口，使系统具有了网络传输的功能。
3 主要模块数据处理
3．1 TMS320DM642数据处理模块的工作流程
TMS320DM642的工作流程如图2所示。上电后，首先初始化DSP的CSL库函数，然后初始化PLL、GPIO及相关中断寄存器，等待中断信号的来临。采集模块中CPLD控制A／D转换器写FIF0，FIF0半满时，通过HF信号通知CPLD，CPLD对TMS320DM642产生一个中断信号，通知DSP将读取的一帧图像数据读入到内存(SDRAM)中，DSP处理过的数据写入DSP内软FIF0，判断写外部接口满足条件后，软FIFO内数据可通过以太网，串口等接口输出。视频信号经解码器转换成数字信号传送到DSP的专用数字视频接口。DSP将采集的信号放到一个临时的缓冲空间里，缓冲空间满后，触发中断。DSP接收到中断后将缓冲空间里的数据放到图像缓存(SDRAM)中。DSP处理数据后，将处理后的数据写入图像输出缓存(SDRAM)。如果写外部接口条件满足，DSP即将处理后的数据从输出缓存中读出，然后经以太网或串口输出。
视频解码器TVP5150通过TMS320DM642的I2C总线设置其内部寄存器等。通过8位的并行数据线将采集到的视频数据传到TMS320DM642的video port口。TMS320DM642的片内视频端口(VP0、VPl、VP2、VP3)可用作视频捕获端口、视频显示端口、视频流传输端口。每个视频在捕获模式或显示模式时可采用8／10位分辨率的ITU-R BT．656的YUV 4：2：2格式，或者作为一个Y／C 16／20位视频通道，以YCbCr4：2：2格式的Y和Cb／Cr分离的形式输入输出。在系统中VP0口作为视频捕获端口，选用8位ITU-R BT656捕获模式(内嵌式同步信号)。配置好TVP5150后，把DSP的相应采集输入口也配置成ITU-R BT.656的输入格式，然后再设置好EDMA通道并使能相关的中断，DSP里面的EDMA会将视频口输入的亮度Y，还有红差CR、蓝差CB的数据自动分开存到TMS320DM642的内部RAM里，从而达到获取视频数据流的目的。
视频采集系统在航天、工业等领域大量存在，随着多媒体技术的快速发展．对视频采集及处理技术系统的性能提出更高的要求，如高采集速度、低功耗、信号连续平滑、延时小、实时性及扩展性等。TI公司推出的TMS320DM642器件很好地解决了上述问题，其丰富的外围接口及专用的视频处理模块使得其非常适合日益发展的视频处理系统。这里，提出了以TMS320DM642为核心，由解码器TVP5150为视频输入解码处理器，与非门Flash为存储器、LXT971为网络传输器组成的集视频采集、压缩、存储、网络传输于一体的多功能视频处理系统。
2 系统硬件设计
图l给出系统硬件原理图。TMS320DM642器件具有强大的处理能力和丰富的外部设备接口。满足各种不同应用环境的控制与图像输出的需要。TMS320DM642在600 MHz的时钟主频下，数字处理能力可达到4 800MI／s，内部具有256 K字节的二级缓存结构：TMS320DM642具有4个可配置的视频接口(VP0～VP3)，能提供与通用视频编解码器等数据流的无缝连接，支持ITU-BT．656等多个视频标准；并具有多通道音频接口(McASP)、10／100 Mb／s以太网介质接入控制器(EMAC)，以适应网络和多媒体的需要，其片内64位的EMIF(Eixtemal Memoryr Interface)接口可以与SDRAM、Flash等存储器件无缝连接，极大方便大量数据的搬移。
TMS320DM642的Boot为EMIFA方式，系统在CEl空间外扩了一片Flash AM29LV320存储器作为程序存储器，当TMS320DM642上电或复位启动时，自动从AM29LV320上加载程序代码。另外系统在CEl空间外扩了一片NAND FlashK9 K8G08130M用来存储处理后的视频数据。同时系统采用Ahera公司的CPLD EPM3064ATCl00，管理系统内的控制信号，包括测试信号、复位信号、使能及中断信号、同步控制信号等，以及对TMS32013M642的部分地址空间的管理，CPLD还预留了部分引脚用于系统功能的扩展。同时TMS320DM642内部集成了以太网控制器外设，在外部只需外扩PHY物理层器件LXT971就可为系统构建一条100 Mb／s的高速以太网接口，使系统具有了网络传输的功能。
3 主要模块数据处理
3．1 TMS320DM642数据处理模块的工作流程
TMS320DM642的工作流程如图2所示。上电后，首先初始化DSP的CSL库函数，然后初始化PLL、GPIO及相关中断寄存器，等待中断信号的来临。采集模块中CPLD控制A／D转换器写FIF0，FIF0半满时，通过HF信号通知CPLD，CPLD对TMS320DM642产生一个中断信号，通知DSP将读取的一帧图像数据读入到内存(SDRAM)中，DSP处理过的数据写入DSP内软FIF0，判断写外部接口满足条件后，软FIFO内数据可通过以太网，串口等接口输出。视频信号经解码器转换成数字信号传送到DSP的专用数字视频接口。DSP将采集的信号放到一个临时的缓冲空间里，缓冲空间满后，触发中断。DSP接收到中断后将缓冲空间里的数据放到图像缓存(SDRAM)中。DSP处理数据后，将处理后的数据写入图像输出缓存(SDRAM)。如果写外部接口条件满足，DSP即将处理后的数据从输出缓存中读出，然后经以太网或串口输出。
视频解码器TVP5150通过TMS320DM642的I2C总线设置其内部寄存器等。通过8位的并行数据线将采集到的视频数据传到TMS320DM642的video port口。TMS320DM642的片内视频端口(VP0、VPl、VP2、VP3)可用作视频捕获端口、视频显示端口、视频流传输端口。每个视频在捕获模式或显示模式时可采用8／10位分辨率的ITU-R BT．656的YUV 4：2：2格式，或者作为一个Y／C 16／20位视频通道，以YCbCr4：2：2格式的Y和Cb／Cr分离的形式输入输出。在系统中VP0口作为视频捕获端口，选用8位ITU-R BT656捕获模式(内嵌式同步信号)。配置好TVP5150后，把DSP的相应采集输入口也配置成ITU-R BT.656的输入格式，然后再设置好EDMA通道并使能相关的中断，DSP里面的EDMA会将视频口输入的亮度Y，还有红差CR、蓝差CB的数据自动分开存到TMS320DM642的内部RAM里，从而达到获取视频数据流的目的。