基于可编程状态机的Turbo译码器设计

4 性能分析

本设计采用Xilinx公司的Spartan-IIE系列作为目标器件，采用Xilinx ISE作为开发环境。根据设计的综合情况，在硬件资源方面，该Turbo码译码器的逻辑模块占用了829个slice，而存储模块则占用了56Kbit的BlockRAM，最高时钟频率约达到50MHz。根据RAM单元的使用情况，该译码器可完成对最大帧长为3 084位的输入序列的译码。

从以上数据可以看出，在使用相对较少硬件资源的情况下，基于KCPSM的Turbo译码器提供了很好的译码性能，同时因在设计时就考虑了灵活性的问题，使其可以很方便地根据实际使用调整译码参数，扩大了应用范围。

本文介绍了基于KCPSM的Turbo译码器设计，并结合该设计说明了基于嵌入式处理器单元的系统设计方法。通过引用Xilinx公司提供的嵌入式处理器IP核，该设计在提供良好译码性能的同时，在使用上也具有很好的灵活性。

随着通信技术的发展，对译码电路的性能要求也将不断提高。本文提出的设计方案也可作为实用ASIC芯片设计方案的参考。基于嵌入式处理器的设计思想可使ASIC设计芯片具有很好的通用性。