基于FPGA的TFTLCD快检信号源的设计

FPGA根据N对时钟脉冲分频计数,分为偶数和奇数的两种情况,N为偶数时比较容易实现,当N为奇数时,需要设置两个分频器,分别对时钟脉冲的上升和下降沿计数,再将这两个结果作逻辑或处理,即可得到结果为(freq×duty)的方波脉冲,再对其进行值为duty的不等分频处理,所得到的就是频率和占空比满足要求的结果。图3是仿真结果,其中m为所要实现的频率freq,n为占空比, temp2为频率为freq×duty的方波信号, clk_gate就是最终的栅极信号。其中时钟clk为2MHz,m为10Hz,n为1/20。

图3　栅极信号

源极信号是通过16路模拟开关AD7506和模拟开关MAX4622产生的。AD7506是16选1的模拟转换开关,通过4位地址输入值选择1路输出。AD7506的16路输入将+5V16等分,每路通过不同的电压值代表不同的灰度等级。其选择信号也是由FPGA产生的,实现16选1的输出。该输出经过正向跟随和反向放大电路作为另一个MAX4622的一组开关(COM₁和COM₃)的输入,由FPGA产生的选通信号Sel1,控制正向电压或反向电压的输出,此输出和公共地又作为MAX4622另一组开关(COM₂和COM₄)的输入,经Sel₂选通,就可得到具有16个不同正负幅值和脉冲宽度均可调的信号,此信号经过运放电路的放大即为所要求的源极信号。其中具体的实现电路如图4所示。

图4　源极信号的产生电路图

其中Sel1是栅极信号经过D触发器而形成的,所以具有一定的滞后。Sel2是栅极信号经过FPGA内部的一个单稳态触发器而实现的, FPGA形成的单稳态触发器由两个D触发器和一个计数器组成,其中cp为上述的(freq×duty)方波,tr为栅极信号, Sel2即为输出信号,其高电平的时间可以根据实际需要在一定范围内随意设定,如图5所示。这样,代表不同灰度等级的交变信号就可加在TFT的源极端

上一页 1 2 下一页