具有多个电压轨的FPGA和DSP电源设计实例（二）

而需要对该转换器在输出端的总电容进行补偿。TI公司在power.ti.com/swift网址提供的参考文件和设计软件可以对转换器的设计和补偿提供帮助。人为地把一个负载阶跃暂态加到转换器的输出端并观察因该转换器响应该暂态而产生的输出电压振铃(振荡)是另一种确定转换器稳定性的方式。作为一个经验法则，如果该转换器在进入稳态之前振荡三次以上，则认为系统濒临不稳定(欠阻尼)。如果响应较慢且没有振铃或超调，则可认为系统是非常稳定的(过阻尼)。

PC处理器可以发生多个在1000A/μs的范围内的负载阶跃暂态，所以既需要保证POL转换器的暂态过程短也需要较大的解耦网络。为降低解耦网络的成本并减小它所使用的板空间，PC母板制造商现在使用目标阻抗方法(或类似方法)来减少电容的数量和充分利用直流/直流转换器的暂态能力。与PC处理器相比，目前单独的FPGA和DSP应用的功率和开关速度均较低。所以，除非FPGA或DSP产生类似于PC处理器的负载阶跃或解耦网络的尺寸太大或成本太高，确定解耦网络尺寸的经验法则是在设计的最优度和快速上市之间进行合理的折衷。

本文小结

　　对于多轨应用，要在线性稳压器和各种类型的开关转换器之间做出合适的选择，不仅需要综合考虑尺寸、效率和成本，也必须考虑通电顺序和启动电流管理等问题。另外，为了在负载阶跃暂态过程中保持调节，转换器很可能需要借助于解耦电容。

作者：Jeff Falin，德州仪器， Email: j-falin1@ti.com