关于晶振及其典型应用的探讨

三、晶振电路设计

有源晶振EMC标准设计电路如下：



原理图注意事项：

(1) 有源晶振的电源引脚最好不要直接接电源，而是通过一个磁珠后接入，这可大大降低电源噪声对时钟输出频率的影响。晶振电源的去耦电容的匹配也很重要，去耦电容一般选3个，容值依次递减。

(2) 有源晶振的时钟输出端串联一个小电阻，作用是为了减少信号反射，以免造成信号反射引起的信号过冲。电阻R1是预留匹配设计，可根据实验情况进行阻值调整。其具体作用如下：

可以减少谐波。有源晶振的输出是方波，当阻抗严重不匹配的时候将引起谐波干扰。加上串联电阻后，该电阻与输入电容构成RC电路，将方波变成正弦波。

可以进行阻抗匹配，减少反射信号的干扰。

(3) C5是预留设计，可根据实验情况进行调整，它的作用是：与串联电阻组成RC滤波电路，减少时钟信号的过冲。

PCB设计注意事项：

(1) 耦合电容应尽量靠近晶振的电源引脚，位置摆放顺序：按电源流入方向，依容值从大到小依次摆放，容值最小的电容最靠近电源引脚。

(2) 晶振的外壳必须接地，可以晶振的向外辐射，也可以屏蔽外来信号对晶振的干扰。

(3) 晶振下面不要布线，保证完全铺地，同时在晶振的300mil范围内不要布线，这样可以防止晶振干扰其他布线、器件和层的性能。

(4) 时钟信号的走线应尽量短，线宽大一些，在布线长度和远离发热源上寻找平衡。

(5) 晶振不要放置在PCB板的边缘，在板卡设计时尤其注意该点。