一种8位嵌入式RISC MCU IP核数据通道模型设计

在该款MCUIP核数据通道模型中，数据总线全部采用本文所述的Verilog HDL代码模型描述。基于中心国际SMIC 0.35μm工艺库(工作电压为3伏)，使用Synopsys公司VCS和 DC对该款MCU IP核进行了仿真综合，并进行了功耗分析。综合分析结果得出，该数据通道电路结构规整，设计得到了简化，总体功耗约为49.5980mW，实现了低功耗设计。

本文使用固定电路结构描述内部数据总线，通过特定层次化数据通道模型的设计，体现了自顶向下(Top-Down)的设计方法，降低了整个MCU IP 核设计的复杂度，缩短了设计周期。该设计适用于大规模系统芯片开发设计。