高速串行数据通信接收芯片CY7B933的原理及应用

3 CY7B933的工作原理及操作方式

3.1 工作原理
CY7B933接收器用于接收来自差分串行输入端的串行位流，它使用内置的集成锁相环（PLL）同步时钟产生器来恢复用于数据重构所需的位同步时钟。成帧器在寻找到串行位流的字节边界后即可产生帧同步时钟。然后输入位流数据即可在移位器中实现串/并转换，同时再送到译码器中译码并检查传送错误。最后将译码后的字节数据在帧同步时钟控制下送到输出寄存器并由并行输出脚输出。

3.2 操作方式


CY7B933具有8B/10B编码方式、旁通方式、内置自测试方式和测试方式四种接收操作方式。

a.8B/10B编码方式
在该编码方式下，串行输入的数据经译码后变成8位数据位，其中包括类型指示位及解码错误指示位。若将收后放在译码寄存器中的数据帧能够在有效数据字符表中找到，则其内容被译为正常的数据信息，并使SC/D输出脚为低电平，假如在有效的特殊字符码及码系统表中找到，则译为“控制”或“协议”信息，并且将SC/D变高。若检测到非法字符，则RVS将变高。

b.旁通方式
在旁通方式下，串行输入数据不需由内部译码器对其译码，而是直接从译码寄存器到10位输出寄存器（Qa-j），然后由外加的译码电路来对其译码，译码方式由设计者确定，这种方式一般不用。

c.内置自测试方式（BIST）
内置自测试功能有以下几种：
（1）设置BISTEN为低，允许自测试产生电路工作。若RDY变低，表明初始化码已找到。
（2）监控RVS并检查该脚是否为高电平。若为高电平，则表明测试到失配样本（数据帧）。
若系统工作正常，则在每次测试循环中使RDY出现一次正脉冲。可以对该脉冲进行计数以监控测试过程。同时Q0～Q7和SC/D等脚也将出现预期的样本值，这一点对系统高度是很有用的。
（3）当测试完成时，设置BISTEN为高电平以恢复正常工作。
BIST方式主要用于检查发送器。由链接线路和接收器构成的整个系统一般不用借助外加的信号及电路，也不用对整个电路作任何改动即可对整个系统进行严格的测试。

d.测试方式
当Mode脚悬空时，接收器处于芯片测试方式。这种方式一般作为工厂进行芯片测试或用户新购大批器件进行测试时使用。



4 CY7B933构成的接收电路设计

由CY7B933构成的接收电路如图3所示，该电路主要由CY7B933接收芯片、IDT7200（FIFO）芯片和阻抗匹配电路等组成。FIFO芯片（IDT7200）的写信号FIFOW由CY7B933的RDY信号提供。利用开关K可将CY7B933的工作设置在8B/10B译码方式或内置自测试方式。
当BISTEN=0时，CY7B933工作在内置自测试方式。此时如果发送芯片CY7B923也工作在内置自测试方式，则可以通过对CY7B923的RP和CY7B933的RDY脚进行测试比较来判断整个系统是否正常工作。若这两个信号同步出现且相位相反（RP为负脉冲，RDY为正脉冲），则表明整个系统的发送电路、接收电路及其链接线路工作正常。

当BISTEN=1时，CY7B933工作在8B/10译码方式。当CY7B933工作在这种方式时，接收并译码后的数据可由 CY7B933提供的RDY信号来写入FIFO芯片IDT7200中。用户可通过FIFO的另一端来读取该信号。注意如按上述电路连接，则此时读取的数据在同步接收到的超始字节中有一个K28.5字符（其值为05H）。若要去掉该字符，可将RDY信号与SC/D信号组合以产生FIFO写信号，这样，该控制字符码（05H）就不会写入FIFO中，从而使FIFO中只包含用户的数据信息。