pads logic问题

各位大侠，我在用pads logic画原理图时候遇到一个问题，一款FPGA由于有些管脚一开始没有使用，所以相应的gate一开始在原理图里被删去了，但是后来又要使用这些管脚，想再把那些gate加上，不知道如何加入。多谢各位！

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