关于DDR的建立和保持时间

Jedec规范上的时序和波形参数，tDS是相对于DQS有效边沿的建立时间，tDH是相对于DQS有效边沿的保持时间，tDS相对于DQ的AC参数，tDH则相对于DQ的DC参数，不过为了测试方面的方便性，我们都可以用AC参数来定义tDS和tDH。

那位兄台知道tDS为什么相对于DQ的AC参数 而tDH则相对于DQ的DC参数吗?多谢。

是为了留出更大的设计裕量吗?

这个定义来自JEDEC的SSTL规范。

tDS是以数据从前一状态变化为当前状态的时刻开始算起，对应于状态变化过程，要确保电平已变化到规定电平，所以以更为严格的AC参数作为参考；

tDH是是数据从稳定到状态转换的时间，对应于电平稳定的过程，而电平一旦建立后，发生状态转换的门限电压值（即DC定义值）比AC要低，所以以DC参数作为参考。

thank you winworm.

1：当信号到达AC时，可以很确定信号电平已经建立起来。所以tDs相对于AC。
2：信号已经建立后，信号在AC和DC之间波动时允许的。所以tDh相对于DC.
个人的理解，不一定对

分上升沿和下降沿去看就很清楚：
在上升沿，信号开始于Vil_DC下，冲过Vih_AC，稳定在Vih_DC上。这个过程中，上升沿最小飞行时间是从测量点到Vil_DC，而最大飞行时间是从测量点到Vih_AC；
在下降沿，信号开始与Vih_DC上，下降到Vil_AC下，稳定在Vil_DC下。在这个过程中，下降沿最小飞行时间是从测量点到Vih_DC，而最大飞行时间是从测量点到Vil_AC；
再从时序上看，建立时间裕量发生在最大的数据延时和最小的时钟延时，保持时间裕量则相反。
这样就不难理解小编的问题了。

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