差分线出现分支时的影响
时间：10-02
整理：3721RD
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请教各位大虾, 差分走线出现分支时的会对信号完整性造成什么样的影响?见下图
先顶起来，期待高手解答！
应该不会太大吧，不过要控制好阻抗
我在DDR上的布线，时钟就是T形分开的，两臂等长
3路差分线等长，输入信号在最中间。
这个好像不太好吧,T型也在Receiver端，且分支不应太长，看看Micron的DDR应用笔记吧，TN4614，里面有关于DDR差分时钟分支及端接的处理