数据总线 f=200M 如何阻抗匹配？

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1, CPU和GMCH之间的距离都很小;

2, I/O BUFFER 自身会有一定的阻抗做匹配.

距离小就不用阻抗匹配吗?它们因阻抗不匹配，还不是会产生反射等?

只听说fpga内部阻抗匹配，没听说x86,dsp,powerpc内部阻抗匹配， 

datasheete 有无I/O BUFFER  阻抗信息?

1, 要了解什么情况下才需要用传输线理论, 他跟信号线长度有关(传输延迟)

2, 任何一个I/O BUFFER 都有阻抗.

谢谢zhxzhh，

那什么情况下才需要用传输线理论呢，不是频率高就需要吗?与信号长短没关系吧?

I/O BUFFER 阻抗怎么知道?

频率高到一定，走线长度到一定时将要考虑传输线理论

IPC-2141的3.4.4提出“当信号在导线中传输时，若导线长度接近信号波长的1/7时，此时的导线被为信号传输线。”（亦有文献认为，导线长接近信号传输波长1/10时，按信号传输线处理。）举例说明如下：

例1、某元件信号传输频率（ƒ）为10MHZ，而PCB上导线上为50cm,是否应考虑特性阻抗?

     解：C= ƒ×入    入=C/ ƒ=（3×10¹⁰cm/sec）/(1×10⁷/sec^-1)=3×10³

         信号传输线=导线长度L/信号波长入=50/3000=1/60  （<1/7为信号传输线）

         ∴  此导线为普通导线，不必考虑特性阻抗问题。

例2、某元件传输频率（ƒ）为1GHZ，而导线长10cm，是否考虑特性阻抗?

入=C/ ƒ=（3×10¹⁰）/(1×10⁹)=30 cm   （1GHZ=1000MHZ）

信号传输线=L/入=10/30=1/3∴  此导线需按信号传输线处理，传输线中的信号会出现反射回来的信号，从而抵消再发射出来的信号。这时该导线要控制特性阻抗，否则，很难实现元件信号传送的效果

ok

理论过硬！

cpu与北桥数据总线 f>200M  原理图上是直接相连的，没有加匹配电阻， 直接连 信号不会有反射吗?高手指点！

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1, CPU和GMCH之间的距离都很小;

2, I/O BUFFER 自身会有一定的阻抗做匹配.

距离小就不用阻抗匹配吗?它们因阻抗不匹配，还不是会产生反射等?

只听说fpga内部阻抗匹配，没听说x86,dsp,powerpc内部阻抗匹配， 

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1, 要了解什么情况下才需要用传输线理论, 他跟信号线长度有关(传输延迟)

2, 任何一个I/O BUFFER 都有阻抗.

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那什么情况下才需要用传输线理论呢，不是频率高就需要吗?与信号长短没关系吧?

I/O BUFFER 阻抗怎么知道?

频率高到一定，走线长度到一定时将要考虑传输线理论

IPC-2141的3.4.4提出“当信号在导线中传输时，若导线长度接近信号波长的1/7时，此时的导线被为信号传输线。”（亦有文献认为，导线长接近信号传输波长1/10时，按信号传输线处理。）举例说明如下：

例1、某元件信号传输频率（ƒ）为10MHZ，而PCB上导线上为50cm,是否应考虑特性阻抗?

     解：C= ƒ×入    入=C/ ƒ=（3×10¹⁰cm/sec）/(1×10⁷/sec^-1)=3×10³

         信号传输线=导线长度L/信号波长入=50/3000=1/60  （<1/7为信号传输线）

         ∴  此导线为普通导线，不必考虑特性阻抗问题。

例2、某元件传输频率（ƒ）为1GHZ，而导线长10cm，是否考虑特性阻抗?

入=C/ ƒ=（3×10¹⁰）/(1×10⁹)=30 cm   （1GHZ=1000MHZ）

信号传输线=L/入=10/30=1/3∴  此导线需按信号传输线处理，传输线中的信号会出现反射回来的信号，从而抵消再发射出来的信号。这时该导线要控制特性阻抗，否则，很难实现元件信号传送的效果

ok

理论过硬！