实现射频信号源的低相位噪声及高速频率切换的共存

选并选择低噪声 DAC带宽可变无源滤波器和介电吸收系数低的滤波器电容。

　　小数乘法器和输出加法环路中的 PLL 采用基于混频器的鉴相器。虽然本底噪声很低，但它们的缺点是捕获范围有限，这是保证 PLL 环路带宽的必要条件。搜索振荡器等传统锁相方法对于这种应用来说速度太慢。当粗调预设相位将 VCO 频率调整到正确范围后，可在锁相之前采用数字鉴相技术 (已申报专利) 精确调整 VCO。FPGA 比较鉴相器两个信号的频率，通过修改预设电压将 VCO 调整到正确频率。

　　由于 PLL 最小带宽为 200 kHz，当 VCO 极为接近锁定时，可以非常迅速锁定设定频率，频率设定可达到 100 μs 的 0.1 ppm。1-GHz 载波频率的误差范围仅为 100 Hz。

　　频率调制

　　频率合成器采用标准两点调制生成宽频带宽频偏调制。FM 系统可利用先进的低成本数字处理技术设置整个 FM 增益，匹配两个内部校准通道的增益和延迟。调制信号可同时加给输出 VCO 和内插频率合成器。由于同时变化，输出 PLL 在鉴相器处无误差。AC 和 DC 输入耦合，以及相位调制也可以采用数字化方式处理。

　　结束语

　　频率合成器利用模拟和数字组合技术实现设计目标，使 Aeroflex S-Series信号发生器具有优异的性能，充分体现了 Aeroflex 产品线几十年来不断推动信号发生器技术进步的显著特点。