基于FPGA和硬件描述语言Verilog的液晶显示控制器的设计

图4中各控制信号之间的时序关系完全符合设计要求。测得一个CP脉冲周期为500ns，在每行结束处有40个CP脉冲周期约20μs的空白信号；LP周期为60μs，高电平持续时间为500 ns，即一个CP周期；FLM周期为14．28 ms，约为70 Hz，高电平持续时间为60μs，即1个LP周期。测试结果表明，本设计液晶控制器完全符合LCM对控制信号的要求。

结语

利用硬件描述语言Verilog设计LCM控制器的方法，具有减小电路板尺寸、易于集成到片上系统、缩小系统体积、方便修改、适应不同液晶显示器等特点，具有很好的可重用性；同时也是后续开发其他种类液晶显示控制器的基础。

本液晶显示控制器与MCU组成显示系统后，MCU将显示数据写入SRAM中，控制器将显示数据读出并与控制信号同步送入LCM中，很好地实现了图形显示。表明该液晶显示控制器成功地替代了传统的ASIC液晶控制器，具有良好的应用前景。