嵌入式系统在可配置系统中实现模拟I/O

电压，配置DSM的最优参数。如果没有合适的参数，DSM会不稳定，出现所谓的限制周期，劣化转换的质量。图5中的两条傅里叶曲线显示了同一DSM电路未优化和优化后组件之间的无杂散动态范围(SFDR)的区别。

从这一优化电路的曲线上您可以看出，我们在这里并没有讨论低速、低分辨率的转换器。这一方法可以用于为系统监控等应用中的不关键慢变信号提供低成本转换器。而这些DSM也适用于任务关键信号的信号通路。Missing Link Electronics公司开发人员社区：www.missinglinkelectronics.com/devzone/的技术摘要上提供这些“软ADC”和“软DAC”质量的详细信息。

但是，恰当的优化输入网络以提高这些基于LVDS的DSM的性能，并不是简单的事情。这需要很好的模拟设计技能，正确的使用FPGA引脚的电信号特性信息。换言之，这通常是专业知识产权(IP)供应商的工作。

为了能够采用这一ADC/DAC方法实现可配置系统，我们推荐图6中的可配置模拟I/O体系结构。它在可配置ADC/DAC中结合了ADC单元和DAC单元，在转换器和先进的数字信号处理(DSP)之间设置了转换滤波器。在我们的试验中，我们发现，在大多数情况下，与其他需要大量资源的滤波器相比，轻量级抽取滤波器能够产生优异的SNR结果。

这意味着，智能系统中的模拟I/O数量主要受限于目的系统所使用的FPGA引脚的数量。设计将其他宝贵的FPGA资源——逻辑单元和片内存储器，大部分留给了开发您的专用数字硬件。

使用基于FPGA I/O引脚的DSM，嵌入式系统的所有关键部分都是“软实现”——软件或者软核CPU的FPGA配置代码;加速器、信号处理流水线或者外设的软核IP;软核ADC和DAC等。因此，智能产品设计人员能够更好的控制嵌入式系统的材料成本，少采用微控制器，找到并更新兼容的FPGA器件。