Stm32时钟分析
进行分析:
(1)
该寄存器中包含dac,电源复位,定时器等外设复位设置,某位为1表示对相应外设复位。开机启动时将该寄存器数据清空。
(2)
同第一步外设复位寄存器的设置。
解答:
RCC->APB1RSTR
RCC->APB2RSTR
这里的“复位结束”具体是什么意思??我把它注释掉后发现也是可以运行的
1是复位.0当然是不复位了
不复位那就是复位结束了.
(3)
STm32有三种启动模式:
1,ISP模式.这种模式就是STM32复位后就执行固化在内部的BOOTLOADER程序(固化的,我们无法读写.),然后等待串口数据,从而实现串口bootloader功能.
这种模式不会从用户存储区启动(除非用串口控制其从0X08000000启动),所以在更新了代码之后,需要设置为其他模式(FLASH模式).
2,FLASH启动模式.这种模式直接从0X08000000启动,也就是我们自己编写的代码的启动方式了.正常情况都应该用这种.
3,SRAM启动模式.这种模式我没有用过,是从0X20000000启动的,也就是说在sram模式开始之前,你要确保SRAM里面已经有代码了,否则就是死机.
RCC->AHBENR = 0x00000014
(4)
RCC->APB1ENR = 0x00000000;
RCC->APB2ENR = 0x00000000;
(5)
RCC->CR |=0x00000001;
stm32的时钟启动过程。
启动过程是:
1,首先使用内部时钟(这也是为什么你不接晶振也可以下载代码了)。
2,尝试开启外部时钟.
3,如果开启成功,则使用外部时钟,否则使用内部。
4,做其他事情。
当然以上代码都需要你自己写代码实现,当然内部时钟是默认的时钟,你不开启也可以.
(6)
RCC->CFGR &= 0xF8FF0000;
这步有什么意思呢,我的理解是。Cfgr寄存器主要用于对时钟分频的控制,见下图:
通过该步的配置:
首先配置MCO无输出,MCO是什么呢?是指可以将stm32的内部时钟通过IO口引脚输出出去,如上图就可以看到,对cfgr的配置,可以有四种mco输出,分别是将pllclk两分频后输出,hsi(片内时钟)输出等。
其次:配置ADCPRE就是上图中AHB分频器线面的ADC
再次:配置ppre2也就是高速外部时钟APB2,这里设成不分频。高速外部时钟主要驱动一些高速外设,这个在APB2ENR时钟控制寄存器中有介绍
再次:配置PPRE1配置低速外部时钟分频APB1这里也全部设成不分频。
再次:配置HPRE。这几个位主要用来配置AHB这个寄存器的分频系数这里也设置成不分频。也就是说上图SYSCLK经AHB没有分频。
最后:配置SW,以及SWS。表示启用HIS作为系统时钟。
到这一步,经过分析得知,RCC->CFGR &= 0xF8FF0000;主要是用来配置ahb等各个分频器的设置,以及将片内时钟作为系统内部时钟。
(6)
RCC->CR &= 0xFEF6FFFF;
通过分析CR寄存器可以看出,该寄存器主要涉及三个时钟PLL,CSS,HSE。
(7)
RCC->CR &= 0xFFFBFFFF;这一步有什么作用呢?查询数据手册57页可知,外部时钟源HSE有两种模式,HSEBYP设置为0时,是选择外部晶体作为外部时钟源这种时钟更加精准,当然也是和外部电路有关的。当然因为第(6)步已经设置了HSEON关闭了,所以这一步才可自由设置HSEBYP。
(8)
RCC->CFGR &= 0xFF80FFFF;
注意:在这一部中可能会有这样的疑问:
RCC->CFGR &= 0xFF80FFFF;
PLLSRC=0 HSI振荡器时钟经2分频后作为PLL输入时钟
PLLXTPRE=0,HSE分频器作为PLL输入,HSE不分频
这样不冲突吗?
答案是:以最后配置为准,就是最后一次配置会改变前一次的配置,所以说以最后一次配置为准。
也就是说后文还有其他代码对其进行定义。那干嘛还要怎么重复配置呢?
有时候是有用的。比如你想让stm32超频一会,然后又恢复正常运行,这就有用了。
(9)
RCC->CIR = 0x00000000;
(10)
#ifndef VECT_TAB_RAM
#else
#endif
下面对该函数分析:
//函数功能:设置向量表偏移地址
//NVIC_VectTab:基址
//Offset:偏移量
void MY_NVIC_SetVectorTable(u32 NVIC_VectTab, u32 Offset)
{
}
前面两行是用来检查参数合法性,这里不作分析。重点看第三行
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