现代DSP芯片功能的扩展

时间：09-30 来源：互联网点击：

多核DSP

飞思卡尔的MSC8144 DSP就是一个好的多核DSP的例子，MSC8144 DSP是基于该公司的的StarCore技术,即特定的第三代SC3400 DSP内核。

这种芯片集成了4个DSP子系统。每个子系统内都有SC3400 DSP内核、16k字节L1指令高速缓存、32k字节L1数据高速缓存、存储器管理单元(MMU)、扩展的可编程中断控制器(EPIC)以及两个通用32位定时器。子系统支持调试和整形，具有低功率“等待”和“停止”处理模式。每个DSP内核运行速率高达1GHz，因此此芯片的性能与4GHz单核DSP的性能相当。

MSC8144还包含该公司的QUICC引擎技术子系统，包括两个RISC处理器、48k字节多主机RAM以及48k字节指令RAM。这种子系统支持三个通信控制器，具有一种异步传输模式(ATM)和两个吉比以太网接口。它也可以从DSP核下载预先安排的任务。

ATM控制器在UTOPIA/PO模式下以25/50MHz支持UTOPIA II级8/16位，适应层支持AAL0、AAL2和AAL5。两个以太网控制器仅使用一个1000Mbit/s数据率4引脚串行器/并行器(SERDES)接口，通过MII/RMII/SMII/RGMII/SGMII和SGMII协议即可支持10/100/1000Mbit/s工作。

与前面提到过的DSP芯片一样，这种芯片的DSP和QUICC子系统的外围有存储器、接口和I/O。至于存储器，芯片包含128k字节L2共享指令缓存、用于关键数据和临时数据缓冲的512k字节M2存储器、96k字节引导ROM和一个庞大的10M字节128位宽M3存储器。

芯片上也有DDR和DMA控制器。DDR控制器具有高达200MHz的时钟(400MHz数据率)和16/32位数据总线。以一或两个组，支持高达1G字节的DDR1和DDR2。DMA控制器具有16个双向通道，高达1024缓冲描述符和可编程优先权、缓冲器和多路传输结构。

芯片级判优与开关系统(CLASS)提供处理部件(和其他启动程序)与目标(如M2存储器、DDR SRAM控制器和器件配置控制和状态寄存器)之间的全部的制作非模块化判优。

MSC8144支持下一代及传统接口，如双吉比以太网、Serial RapidIO互连、UTOPIA、PCI以及分时多路复用(TDM)。

Serial RapidIO 1×/4×端点符合RapidIO贸易协会的规范1.2。它支持读、写、信息、门铃、入站模式的维护接入以及出站模式的信息和门铃。PCI接口遵守PCI规范修订版2.2，以33或66MHz读写所有PCI地址空间。

多达8个片上独立的TDM模块提供的特征有可编程字大小(2、4、8或者16位)、基于硬件的A法则/μ法则转换、所有通道的数据率都高达128Mbit/s、与E1、或T1帧调节器无缝接口、与H-MVIP/H.110设备、TSI和编解码器如AC97的接口能力。

由于有多核架构和下一代及传统接口，MSC8144DSP非常适合大容量基础设施应用。包括三用(语音、视频和数据)业务、通过载波分类/企业语音互联网协议(VoIP)媒体网关设备、视频会议设备以及WCDMA和WiMAX基站。

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