一次性可编程时钟产生器OmniClock可提供最高设计灵活性和丰富功能

地减小阻抗差异。

为使器件不受到系统电源噪声的影响，需贴装一个0.1 uF和一个2.2 uF的去耦电容到线路板，且尽可能离VDD引脚近。到VDD引脚的线路板走线和接地通孔应当尽可能薄和短。所有VDD引脚都应当有去耦电容。

差分信号如LVDS具有共模噪声抑制和低噪声的固有优势，支持快速开关速度，且功耗较其它差分信号标准低，扇出的LVDS缓冲可用作扩展以提供时钟信号到多个LVDS接收器，驱动多个点对点链接到接收节点。

总结

OmniClock系列为当前市场上任何可编程的时钟器件提供最多的功能和灵活性，该系列器件接受一系列晶体或参考时钟输入频率以产生一路差分输出(LVPECL, LVDS, HCSL, CML)加一路单端，或以用户定义的频率达三路单端LVCMOS输出，支持从8 KHz到200 MHz的任意输出频率，替代晶体和/或振荡器，节省占板面积，降低整体系统成本，超越完全采用分立晶体的系统，改善串扰/抖动，增强系统可靠性，同时大大简化电路板设计，并使客户能满足他们系统低功耗的要求，比晶体缩短交期，可定制的扩频配置还可用于对EMI敏感的应用。