解决多总线系统级芯片测试问题的多域方法

图2所示，北桥部分具有多路总线，但只需要有限个独立的时钟域用于测试。这些总线通过内部PLL进行计时，该PPL的参考时钟通常工作在很低的频率上。前 端总线(FSB)时钟的频率为133MHz，而数据的频率则是其四倍。在AGP时钟频率为66MHz的情形中，内部PLL可以将该频率提升8倍，达到 533MHz。术语"4倍频"则能以另一种方式指示数据由频率是主时钟数倍的内部时钟进行计时。

尽 管众多不同的时钟处于北桥的一个域中，但DCLKIN引脚(内存时钟)并不同支持其余时钟的测试器周期完全对齐。为了处理这种非对齐波形，带有时间设定支 持的测试器可在连续的方向上提供不同的边缘器件。例如，测试模式生成软件可生成具有8项时间设置的重复模式，这些时间设置可在测试器上重复生成。

总体而言，测试工程人员可采用以下两种常用解决方案(单时域或多时域)中的一种解决时钟域问题：

* 单时域：测试模式采用时间设置重生成域关系，该方法可能用尽目标ATE上的时间设置/边缘设置内存。

* 多时域：仿真数据将拆分为具有独立时序的多个ATE模式，该方法依赖于器件设计。

当启动首个多域项目时，如果ATE系统支持，那么理想的方法是在特定的模式上实现这两种方法。这种方法可以使测试工程人员在调试期间获取更多的灵活性。

将 模式转换为特定测试器周期边界的过程称为"周期化"。典型的测试向量生成工具默认状态下将尝试生成单时域模式，但许多早期的ATE平台具有受限的时间设置 资源，而且一些模式完全不适合或者需要在较低的频率上运行。实现多个测试器周期则更为困难，但测试工程人员可在不同的速率条件下为实现"周期化"以进行 I/O子集处理。测试中，载入不同的模式集并在ATE上作为独立实体运行。如果混淆了引脚顺序，那么将很难区分属于不同时钟域的引脚。这时，脚本就是对现 有专用于检查的模式文档中的总线进行分组的最有效工具。不同的ATE对于所能支持的域数目及每组中引脚的数目具有不同的限制。因此，测试工程人员在设计测 试架构之前，充分了解域的需求至关重要。

小结

除了DUT特性，测试工程人员还必 须充分了解目标测试器的性能，以有效地采用多域测试方法。除了支持的时域数目，工程人员还需要了解支持的时间设置数目和任何高速率限制。这时物理学原理也 同样适用，而且许多工程人员还试图理解任何平台上I/O频率超过150MHz条件下的聚焦标准和往返时延。

作者：Ross Youngblood

Credence Systems公司