问个电路图方面的问题 关于D触发器
时间:10-02
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D端和Q反 连在一起 逻辑关系是什么样的
D就是CLK的二分频
假设D当前状态是1,clk到来后,Q为1,Q反为0,这时D也变成0,等到下一个clk到来,Q为0,Q反为1,D又变成1,循环下去就是一个clk的二分频器。
对。、。
好