关于层次式原理图总线连接问题
时间：10-02
整理：3721RD
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一个模块的总线可以在主模块中分出信号线进入另一个模块吗?我这样操作但是编译有错误，请问该如何改正呢?
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2016-7-11 19:31 上传
