如何实现输入三态?大家帮忙看一下我这个程序引脚该如何配置?
时间:10-02
整理:3721RD
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具体情况如下:芯片和单片机之间采用一种时序来通信,一根时钟线SCLK,一根数据线DO,DO双向。首先我要用单片机给芯片写入些东西,然后将对应IO口设置为输入,然后芯片中的一些数据会自动传送给单片机。就是这样一个流程,现在有点小问题:(1)我给芯片原厂技术人员提问题询问这两个引脚在单片机如何设计的时候,他们这样给我回复:When programming through SCLK and DO pin, the MCU must be in output, either pull high, after programming complete the I/O pin must be set to input with tri-state or week pull high.
[size=18.6667px]首先,我尽量不用上拉硬件实现,想通过软件实现。他那句[size=18.6667px]set to input with tri-state,我给芯片配置完之后,只需要将DO(数据)引脚设置输入就行了吗?不太懂这里的输入三态啥意思?
[size=18.6667px]而且,时钟线应该没啥影响,我拉低或者配置完之后软件置低是不是均可,并非要向他说的拉高?
[size=18.6667px]感激不尽!
[size=18.6667px]首先,我尽量不用上拉硬件实现,想通过软件实现。他那句[size=18.6667px]set to input with tri-state,我给芯片配置完之后,只需要将DO(数据)引脚设置输入就行了吗?不太懂这里的输入三态啥意思?
[size=18.6667px]而且,时钟线应该没啥影响,我拉低或者配置完之后软件置低是不是均可,并非要向他说的拉高?
[size=18.6667px]感激不尽!
如你所述即I2C,一种总线结构。总线空闲时,因各设备都是开漏输出,上拉电阻使SDA和SCL线都保持高电平。任一设备输出的低电平都将使相应的总线信号线变低,也就是说:各设备的SDA是“与”关系,SCL也是“与”关系。这里所讲的开漏输出就是I/O口的第三态,线上的上拉电阻必须存在。
我也看看什么解决方法,
看你是什么单片机吧,有的单片机引脚不一定能实现这些功能
这个虽然不太懂 但是根据电子基础知识 感觉4楼坛友的分析非常正确