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Candence问答

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【疯狂爱答】Candence问答

第二季疯狂爱答,唤醒你的记忆,重出江湖了。还记得第一季中,小伙伴们闪闪发光的智慧头脑吗?还记得为你解答过问题的发烧友吗? 一起来答题,交流技术,向大牛取经,与小鸟一起成长吧。


在上一季的疯狂爱答中,@youzizhile @z00 @依然落叶飘零 @woodmice是最具人气的

最具活力的社区用户,在单片机,STM32,电路设计,电源技术,FPGA系列问答中总是能看到他们热

情的分享知识的身影。因为你们,或是帮助,或者是技术问题的探讨,解惑许多。管理员组认为你们

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问题汇总:0、想从事allegro布线这方面的,还请各位不吝赐教

1.  Altium Designer 多通道设计网络设置问题?  http://bbs.elecfans.com/jishu_453931_1_1.html

2.  Allegro 16.3怎么导Artwork http://bbs.elecfans.com/jishu_321656_1_8.html
3.  LED显示屏的问题? http://bbs.elecfans.com/jishu_448495_1_1.html
4.  内电层分割时,能不能分割成多个不连续块么? http://bbs.elecfans.com/jishu_452522_1_1.html
5.  分享一些曾经设计过的MID 六层,欢迎发表看法? http://bbs.elecfans.com/jishu_344320_1_1.html
6.  有谁能帮忙解释一下Type 3/Type 4 PCB Stack-Up吗?http://bbs.elecfans.com/jishu_451251_1_2.html

7.  如何将公司公共的库lib放到自己的lib中?http://bbs.elecfans.com/jishu_450856_1_2.html

8.  16.5里面怎么设置shape以不同的方式连接smd pad?http://bbs.elecfans.com/jishu_450061_1_2.html
9.  assembly_detail 这个subclass的信息如何自动生成?http://bbs.elecfans.com/jishu_450183_1_2.html
10. cadence画原理图库修改管脚属性不起作用? http://bbs.elecfans.com/jishu_449961_1_3.html
11. 利用cadence hdl制作元件库时出现pdV_351:parsingerror?http://bbs.elecfans.com/jishu_449385_1_3.html
12. allegro如何修改已经画好的PCB板子,增加二三十个元件?http://bbs.elecfans.com/jishu_449305_1_3.html
13. cadence 原理图库从design cache 中导出来问题?http://bbs.elecfans.com/jishu_448398_1_3.html
14. allegro封装的虚线该如何画出来? http://bbs.elecfans.com/jishu_448095_1_3.html
15. 请问allegro中添加焊盘库成功,但在mannually中怎么不能显示? http://bbs.elecfans.com/jishu_444172_1_3.html
16. Capture16.2中,原理图编译时出现LAST USED EFERENCES?http://bbs.elecfans.com/jishu_444547_1_4.html
17.  复制DDR,如何差分走线到另一个板上?  http://bbs.elecfans.com/jishu_441442_1_4.html
18.  正片 十字焊盘连接线宽大小设置?  http://bbs.elecfans.com/jishu_437432_1_4.html
19.  ALLEGRO如何导出特殊要求的BOM?  http://bbs.elecfans.com/forum.php?mod=viewthread&tid=434492&page=1&extra=#pid2931989
20.  CAD的ME结构图会不会把所有元件的位置固定?http://bbs.elecfans.com/jishu_434025_1_5.html
21. ALLEGRO blank rats后依旧有部分飞线显示,怎么破?http://bbs.elecfans.com/jishu_433493_1_5.html
22. 关于ICA网上抓取元件的问题?  http://bbs.elecfans.com/jishu_431482_1_5.html
23.  OrACDcapture cis 使用中问题:通过CIS网络抓取功能获得元器出错了? http://bbs.elecfans.com/jishu_430579_1_5.html24.  Allegro 16.5破解安装完之后 菜单栏没有 Layout 选项,是怎么回事呢?
http://bbs.elecfans.com/jishu_425092_1_5.html
25.  cadence 中SI model 怎么建立? http://bbs.elecfans.com/jishu_423681_1_5.html
26.  allegro布局仿真求助?   http://bbs.elecfans.com/jishu_422460_1_5.html
27.  在Allegro 16.6中默认是2层板的,那怎样设置单层板呢?http://bbs.elecfans.com/jishu_301271_1_5.html
28.  candence(16.5) concept hdl 设计的原理图在导出brd文件时出错? http://bbs.elecfans.com/jishu_340370_1_8.html
29.  宏模块出错?  http://bbs.elecfans.com/jishu_336775_1_8.html
30.  关于PCB EDITOR 中导入DXF文件的问题? http://bbs.elecfans.com/jishu_333245_1_8.html
31.  怎么使导线不间断呢?求助.  http://bbs.elecfans.com/jishu_324063_1_8.html
32.  画PCB时,都要注意哪些东西?  http://bbs.elecfans.com/jishu_453177_1_1.html[size=13.63636302948px]

【疯狂爱答】Orcad问答

【疯狂爱答】Cadence问答

【疯狂爱答】Altium Design(Protel,DXP)问答

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