ddr3设计时的容性补偿
时间：10-02
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DDR3地址线，clock线要做容性补偿，一般前后线宽相差多少，或者说阻抗相差多少啊?
一般做容性补偿的情况都是4片或8片颗粒以上才需要，个人觉得阻抗一般相差5~10欧姆比较好。