模拟IP的verilog model是什么，在模拟电路设计过程中属于那一阶段，有什么作用？
时间：10-02
整理：3721RD
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如题，刚开始接触模拟IP的verilog model，想对其有个大概的了解。模拟IP的verilog model是什么，在模拟电路设计过程中属于那一阶段，有什么作用?
希望有人来回答~
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在论坛上看到verilog-a和verilog-ams behavior model 是做数模混仿的，请问verilog model和这二者有什么区别呢?求指点迷津啊！