上拉电阻下拉电阻的总结-

上拉电阻：
1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电平低于COMS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。
2、OC门电路必须加上拉电阻，才能使用。
3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电阻。
4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬空，一般接上拉电阻产生降低输入阻抗，提供泄荷通路。
5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号的噪声容限增强抗干扰能力。
6、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电磁干扰。
7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电阻匹配，有效的抑制反射波干扰。
上拉电阻阻值的选择原则包括:
1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大，电流小。
2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。
3、对于高速电路，过大的上拉电阻可能边沿变平缓。
综合考虑以上三点,通常在1k到10k之间选取。对下拉电阻也有类似道理
对上拉电阻和下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设定，主要需要考虑以下几个因素：
1． 驱动能力与功耗的平衡。以上拉电阻为例，一般地说，上拉电阻越小，驱动能力越强，但功耗越大，设计是应注意两者之间的均衡。
2． 下级电路的驱动需求。同样以上拉电阻为例，当输出高电平时，开关管断开，上拉电阻应适当选择以能够向下级电路提供足够的电流。
3． 高低电平的设定。不同电路的高低电平的门槛电平会有不同，电阻应适当设定以确保能输出正确的电平。以上拉电阻为例，当输出低电平时，开关管导通，上拉电阻和开关管导通电阻分压值应确保在零电平门槛之下。
4． 频率特性。以上拉电阻为例，上拉电阻和开关管漏源级之间的电容和下级电路之间的输入电容会形成RC延迟，电阻越大，延迟越大。上拉电阻的设定应考虑电路在这方面的需求。
下拉电阻的设定的原则和上拉电阻是一样的。
OC门输出高电平时是一个高阻态，其上拉电流要由上拉电阻来提供，设输入端每端口不大于100uA,设输出口驱动电流约500uA，标准工作电压是5V，输入口的高低电平门限为0.8V(低于此值为低电平)；2V(高电平门限值)。
选上拉电阻时：

500uA x 8.4K= 4.2即选大于8.4K时输出端能下拉至0.8V以下，此为最小阻值，再小就拉不下来了。如果输出口驱动电流较大，则阻值可减小，保证下拉时能低于0.8V即可。

当输出高电平时，忽略管子的漏电流，两输入口需200uA

200uA x15K=3V即上拉电阻压降为3V，输出口可达到2V，此阻值为最大阻值，再大就拉不到2V了。选10K可用。COMS门的可参考74HC系列
设计时管子的漏电流不可忽略，IO口实际电流在不同电平下也是不同的，上述仅仅是原理，一句话概括为：输出高电平时要喂饱后面的输入口，输出低电平不要把输出口喂撑了（否则多余的电流喂给了级联的输入口，高于低电平门限值就不可靠了）

版主还真勤奋！致敬！

是啊,总结的这么多.....P服!

我也顶一下可我还是想知道为什么老这么一个在发会员为什么都不发呢？？

说得好啊，正所谓享受容易－奉献难啊！

顶斑竹～～～

thanks我是新手,我现在需要一些电子工程师的基础工具书,能介绍些给我参考吗？E:city833@163.comQQ:512711941

向您学习,总结是个好习惯

这个好象是一个人总结的吧我记着很多资料都是这样的呢

不错

希望多總結一些其它的出來啦

好啊，我正在找这方面的资料，就是想搞清楚上拉电阻的事情啊

总结得好，谢谢

向您学习,总结是个好习惯

版主辛苦啦总结的不错，IC的I/O口用上拉电阻解决了驱动不足问题，但误驱动时能不能同时用下拉电阻呢？好像在实际电路中没看到同时用。

尊重楼主劳动呵呵

看了一会,不错.

good

顶～

小子受教了，谢谢

能给出几个典型应用的例子就更好了

总结的好！顶！

ding

学习学习

xuexixuexi

好好

ddddd!

学到不少东西

谢谢

XIEXIE

不明白 不过还是顶

yes

haha,搂主辛苦了！等一下！

haha,搂主辛苦了！等一下！非常喜欢！

好东东，学习下先！

其实看完了 还是有点不太了解的

没什么时候:D

楼主辛苦了

很详细！！！1

很好的资料啊``谢谢了

谢谢你的奉献

谢谢你

非常感谢

楼主辛苦拉

不错支持楼主

增长见识

:D 好!!!!!!!!!!!!!!!!!!!!

受益非浅

说得好啊，谢谢