异步FIFO指针同步产生的问题
时间:10-02
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如图所示的异步FIFO,个人觉得在读写时钟同步时会产生两个时钟周期的延时,如果读写时钟频率相差不大,某一时刻读写指针相等,当写指针同步到读模块时会产生延时,实际同步到读模块的写指针是两个时钟周期之前的,这样就不会产生空满信号,要两个周期之后才能产生空满信号,结果是写溢出或读空
异步FIFO结构
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