arm中的PLL，MPLL，UPLL，FCLK，HCLK，PCLK的作用概述

不同公司，不同等级的ARM架构也是有许多共同的地方，因此以最为广泛使用的2440为实例讲解。

一，PLL
S3C2440 CPU主频可达400MHz，开发板上的外接晶振为12M，通过时钟控制逻辑的PLL（phaselockedloop，锁相环电路）来倍频这个系统时钟。2440有两个PLL（phaselockedloop）一个是MPLL，一个是UPLL。UPLL专用于USB设备，常用频率为48MHz和96MHz。MPLL用于CPU及其他外围器件，用于产生FCLK，HCLK，PCLK三种频率，上电时，PLL并没有被启动，FCLK=Fin=12MHz，若要提高系统时钟，需要软件来启动PLL。

1，FCLK是CPU提供的时钟信号。

2，HCLK是为AHB总线提供的时钟信号，AdvancedHigh-performanceBus，主要用于高速外设，比如内存控制器，中断控制器，LCD控制器，DMA等。

3，PCLK是为APB总线提供的时钟信号，AdvancedPeripheralsBus，主要用于低速外设，比如看门狗，UART控制器，IIS,I2C，SDI/MMC,GPIO，RTCandSPI等。

二，参考文件
1，http://blog.csdn.net/heqiuya/article/details/8021655
2，http://zhidao.baidu.com/link?url=BAvsqdcOAUPbMGVpv8NPjB8bs9HG9wpnKcZy65C0tK-V71W-TGBE0iVcbs3lmlOZbdVKT96d8Mq5iCr2Si6r8gX1aJxlF32GKwDPrrl55UG