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spectre调用veriloga出错求助

时间：10-02 整理：3721RD 点击：

各位，我在用spectre仿真晶体管级电路，内部使用了veriloga写的一个继电器开关模型，但是网表都导不出来，报错截图如附件，请大家帮忙看看。

没人回复么，自己顶帖

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