请教－－－OTA DC GAIN @ .18uM Process
时间：10-02
整理：3721RD
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请教大家：
1。台积电。18工艺：
2。采用折叠共源共栅结构的OTA;
3。MOS采用最小沟道长度；
这种条件下的OTA DC gain最小值能超过54dB吗?
谢谢！
1。台积电。18工艺：
2。采用折叠共源共栅结构的OTA;
3。MOS采用最小沟道长度；
这种条件下的OTA DC gain最小值能超过54dB吗?
谢谢！
好像有点难度。
output stage try to adding gain boost
3。MOS采用最小沟道长度； ===========〉〉〉〉why?
1。最关心的是功耗；
2。CIFF系统结构决定OTA DC GAIN线性可以宽松些；
3。采用大的沟道长度，寄生电容大，构成积分器闭环反馈后的等效负载电容大，功耗很容易就上去了；
4。gain-boosting 功耗也是超级大，只有在不得以的情况下才出此招；
5。要是能搞到50dB也凑合用用。这能达到吗?