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高速数据采集和生成
高速数据采集前端解决方案的方框图 (SBD)，它使用高速 ADC 和 DAC、放大器和 TI DSP 来采集、分析并生成高速模拟信号
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设计注意事项
高速数据采集系统
高速数据采集系统采用高速集成电路来触发和采集高数据速率流控制和存储。
内核子系统包括：
模拟输入前端 - 安装在高速 ADC（包括高速运算放大器、FIFO 和 SRAM）的周围。ADC 的数据输出流被写入 FIFO，存储在 SRAM 块中，并在 FPGA 的数据采集逻辑的控制下通过寄存器直接发送至外界。
  
FPGA - 包含数据采集控制和逻辑（包括触发逻辑）、检错、DSP 接口、存储器地址解码器、计数器和输出控制。控制逻辑选择一个数据采集时钟，处理各种触发器，并将获取的数据传输至数据采集通道的内部存储器中。
  
模拟输出 - 安装在高速 DAC（包括运算放大器和输出数据缓冲器）的周围。
  
高速总线接口 - 通过背板（PCI、VMEbus）上的高速并行总线或高速以太网传输数据。
  
时钟源 - 为不同的数据采集选项和模式提供时钟。
  
电源管理 - 转换背板的输入电源以运行各种功能块。

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